軟考嵌入式系統(tǒng)設計師考試經(jīng)典100題61-70

嵌入式系統(tǒng)設計師 責任編輯:陳湘君 2024-02-27

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摘要:軟考嵌入式系統(tǒng)設計師考試經(jīng)典100題由希賽網(wǎng)整理,本文是軟考嵌入式系統(tǒng)設計師考試經(jīng)典100題的61-70題內容,以便考生對嵌入式系統(tǒng)設計師考試知識點的掌握檢測。

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61、以下關于嵌入式系統(tǒng)時鐘管理的敘述中,錯誤的是(  )。

A.系統(tǒng)的主時鐘可以由外部時鐘源提供,也可由外部晶體振蕩器提供

B.時鐘控制邏輯可以在不需要鎖相環(huán)的情況下產生慢速時鐘

C.利用鎖相環(huán)可以對輸入時鐘進行倍頻輸出,但無法改變輸出時鐘的相位

D.可以通過軟件來控制時鐘與每個外圍模塊的連接還是斷開

62、以下關于嵌入式實時操作系統(tǒng)(RTOS)的敘述中,錯誤的是(  )。

A.實時性和公平性是RTOS調度器最重要的兩個指標

B.RTOS調度器多采用基于優(yōu)先級的可搶占調度算法

C.單調速率調度算法的基本思想是任務的周期越短,優(yōu)先級越高

D.最早期限優(yōu)先算法會根據(jù)任務的截止時間來確定其優(yōu)先級

63、在進行嵌入式系統(tǒng)硬件電路設計時,可采用(  )增強電路的抗干擾能力。

A.布線時走90度折線

B.使用IC插座

C.布線時減少回路環(huán)的面積

D.閑置未用的I/O口盡量懸空

64、嵌入式系統(tǒng)硬件PCB圖設計及布線過程中應遵循的原則不包括(  )。

A.先復雜后簡單

B.核心器件優(yōu)先

C.高速信號優(yōu)先

D.先局部后整體

65、嵌入式系統(tǒng)中常用BIT(內置自檢測)來檢測硬件的狀態(tài)。BIT通??煞譃樯想夿IT、 周期BIT、啟動BIT、維護BIT等,其中不能影響應用軟件正常運行的是(  )。

A.上電BIT

B.周期BIT

C.啟動BIT

D.維護BIT

66、將一個32位數(shù)0x12345678存儲到8000H?8003H四個字節(jié)單元中,若以小端模式存儲,則8000H存儲單元的內容為(  )。

A.0x12

B.0x21

C.0x78

D.0x87

67、RS232接口接收數(shù)據(jù)時,可以采用查詢和中斷兩種方式,其中采用中斷方式的特點是(  )。

A.硬件電路簡單,易于設計

B.不長期占用CPU資源,系統(tǒng)開銷小

C.設計復雜,降低了系統(tǒng)的實時性

D.軟件設計簡單,可移植性好

68、在處理器的指令系統(tǒng)中,程序控制類指令的功能是(  )。

A.改變程序執(zhí)行的順序

B.進行主存和CPU之間的數(shù)據(jù)傳送

C.進行CPU和I/O設備之間的數(shù)據(jù)傳送

D.進行算術運算和邏輯運算

69、某系統(tǒng)中采用固定優(yōu)先級調度,有3個任務,優(yōu)先級順序為X>Y>Z,任務Z先執(zhí)行,并且運行過程中獨占了共享資源S,在釋放S之前,任務X和Y開始運行,X也申請資源S,Y和Z之間沒有共享資源,則三個任務執(zhí)行完成的順序是(  )。

A.X、Y、Z

B.Y、X、Z

C.Y、Z、X

D.Z、X、Y

70、假設某系統(tǒng)總線在一個總線周期中并行傳輸4字節(jié)信息,一個總線周期占用2個時鐘周期,總線時鐘頻率為10MHz,則總線帶寬是(  )。

A.10MB/s

B.20MB/s

C.40MB/s

D.80MB/s

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